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来源：学生作业帮编辑：神马作文网作业帮分类：英语作业时间：2024/11/12 07:37:31

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数字频率计是数字电路中的一个典型应用,实际的硬件设计用到的器件较多,连线比较复杂,而且会产生比较大的延时,造成测量误差、可靠性差.基于VHDL语言,将使整个系统大大简化,提高整体的性能和可靠性.VHDL语言作为先进的硬件描述语言,也以其灵活、简洁的设计风格再电路设计中发挥着越来越重要的作用.本文介绍了频率测量的基本原理和方法,主要论述了用中规模集成电路设计数字频率计的总体方案,绘制出硬件原理图.并在MAX+PLUSⅡ平台上,用VHDL语言完成了分频模块、计数模块、锁存模块、显示模块和上层模块等五个部分的软件设计、编译和调试工作.

The digital frequency meter is a classic application of digital circuits. The actual hardware design uses more devices; the circuitry is more complicated and will also produce a longer delay, resulting in calculation errors and poor reliability. But the VHDL language simplifies the entire system significantly and improves the overall functions and reliability. The VHDL language as an advanced hardware description language is playing a more and more important role in digital circuitry designs with its nimble and simple design style. This article presents the basic theory and method of frequency measurements and mainly discusses the overall program for designing digital frequency meters using medium scale integrated circuit designs to draft the hardware schematic diagram. We will also complete the following 5 components of software design, compilation and debugging using the VHDL language on the MAX + PLUS II platform: the frequency division module, the counting module, the latch (或 loop) module, the display module and the upper layer module.

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