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在verilog中,相乘表达式能够综合吗?比如c=b*a能够综合成乘法器吗?若能综合,那综合出来的是什么乘法器

来源:学生作业帮 编辑:神马作文网作业帮 分类:综合作业 时间:2024/10/04 01:16:28
在verilog中,相乘表达式能够综合吗?比如c=b*a能够综合成乘法器吗?若能综合,那综合出来的是什么乘法器
在verilog中,相乘表达式能够综合吗?比如c=b*a能够综合成乘法器吗?若能综合,那综合出来的是什么乘法器
能综合啊,但不是很优化.
可以自己写,或者用fpga实现的话,有相应的ip核可以调用,厂商提供的ip核在速度、面积上都是最优化的.